A 15-ns 16-Mb CMOS SRAM with interdigitated bit-line architecture : Memory and logic

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Bibliographische Detailangaben
Veröffentlicht in:IEEE journal of solid-state circuits 1992, Vol.27 (11), p.1497-1503
Hauptverfasser: MATSUMIYA, M, KAWASHIMA, S, SAKATA, M, OOKURA, M, MIYABO, T, KOGA, T, ITABASHI, K, MIZUTANI, K, SHIMADA, H, SUZUKI, N
Format: Artikel
Sprache:eng
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Beschreibung
Zusammenfassung:
ISSN:0018-9200
1558-173X