A 6-GSamples/s multi-level decision feedback equalizer embedded in a 4-Bit time-interleaved pipeline A/D converter

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Bibliographische Detailangaben
Hauptverfasser: VARZAGHANI, Aida, KEN YANG, Chih-Kong
Format: Tagungsbericht
Sprache:eng
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Online-Zugang:Volltext
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Beschreibung
Zusammenfassung:
ISSN:0018-9200
1558-173X
DOI:10.1109/JSSC.2006.870911