Performance Evaluation Of Instruction Scheduling On The IBM RISC System/6000

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Bibliographische Detailangaben
Hauptverfasser:	Bernstein, D., Cohen, D., Lavon, Y., Rainish, V.
Format:	Tagungsbericht
Sprache:	eng
Schlagworte:	Cities and towns Computer architecture Out of order Parallel processing Performance evaluation Pipeline processing Processor scheduling Reduced instruction set computing Scheduling algorithm VLIW
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Beschreibung
Zusammenfassung:
DOI:	10.1109/MICRO.1992.697024