A sub-10ps multi-phase sampling system using redundancy

The feasibility of sampling with clock phases spaced by a bin size of

Bibliographische Detailangaben

Hauptverfasser:	Li-min Lee, Chih-Kong Ken Yang
Format:	Tagungsbericht
Sprache:	eng
Schlagworte:	Circuits Clocks Jitter Noise reduction Phase measurement Phase noise Redundancy Sampling methods System testing Voltage
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