TIME TO DIGITAL CONVERTER (TDC) CIRCUIT WITH SELF-ADAPTIVE TIME GRANULARITY AND RELATED METHODS
A time-to-digital converter (TDC) circuit generates a digital output indicating a time, known as a phase difference, from a phase of the generated signal to a corresponding phase of a reference signal. The digital output is used by the digitally controlled oscillator (DCO) to correct for the phase/f...
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Format: | Patent |
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Zusammenfassung: | A time-to-digital converter (TDC) circuit generates a digital output indicating a time, known as a phase difference, from a phase of the generated signal to a corresponding phase of a reference signal. The digital output is used by the digitally controlled oscillator (DCO) to correct for the phase/frequency difference to synchronize the generated signal with the reference signal. In an aspect, an adaptive TDC circuit generates a first digital indication in a coarse mode when the offset time is above a threshold and generates a second digital indication in a fine mode when the offset time is below the threshold. The first digital indication and the second digital indication each comprise a same number of bits, and the first digital indication is normalized to the second digital indication for the digital output of the adaptive TDC circuit. A fractional bit may be employed to compensate for a quantization error.
La présente divulgation concerne un circuit convertisseur temps-numérique (TDC) qui génère une sortie numérique indiquant un temps, connu sous le nom de différence de phase, allant d'une phase du signal généré à une phase correspondante d'un signal de référence. La sortie numérique est utilisée par l'oscillateur à commande numérique (DCO) pour corriger la différence de phase/fréquence afin de synchroniser le signal généré avec le signal de référence. Selon un aspect, un circuit TDC adaptatif génère une première indication numérique dans un mode grossier lorsque le temps de décalage est supérieur à un seuil et génère une deuxième indication numérique dans un mode fin lorsque le temps de décalage est inférieur au seuil. La première indication numérique et la deuxième indication numérique comprennent chacune un même nombre de bits, et la première indication numérique est normalisée à la deuxième indication numérique pour la sortie numérique du circuit TDC adaptatif. Un bit fractionnaire peut être utilisé pour compenser une erreur de quantification. |
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