GATE DRIVER

This gate driver, which is for driving an N-channel type transistor connected between a terminal for impressing an input voltage and a terminal for impressing a switch voltage, comprises: a capacitor circuit that is connected between a terminal for impressing a boot voltage that is higher than the s...

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1. Verfasser: IMADA Takehiko
Format: Patent
Sprache:eng ; fre ; jpn
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Beschreibung
Zusammenfassung:This gate driver, which is for driving an N-channel type transistor connected between a terminal for impressing an input voltage and a terminal for impressing a switch voltage, comprises: a capacitor circuit that is connected between a terminal for impressing a boot voltage that is higher than the switch voltage by the voltage between the terminals of a boot capacitor and the terminal for impressing the switch voltage; and a timing control circuit that, after input gate capacity of the transistor has been precharged by the input voltage during an on-transition of the transistor, charges the input gate capacity with the boot voltage and lowers the capacity value of the capacitor circuit after an on-transition of the transistor. Ce circuit d'attaque de grille, qui est destiné à commander un transistor de type à canal N connecté entre une borne servant à imprimer une tension d'entrée et une borne servant à imprimer une tension de commutation, comprend : un circuit de condensateur qui est connecté entre une borne servant à imprimer une tension de démarrage qui est supérieure à la tension de commutation par la tension entre les bornes d'un condensateur de démarrage et la borne servant à imprimer la tension de commutation ; et un circuit de commande de synchronisation qui, après que la capacité de grille d'entrée du transistor a été préchargée par la tension d'entrée pendant une transition d'activation du transistor, charge la capacité de grille d'entrée avec la tension de démarrage et abaisse la valeur de capacité du circuit de condensateur après une transition d'activation au niveau du transistor. ゲートドライバは、入力電圧の印加端とスイッチ電圧の印加端との間に接続されたNチャネル型のトランジスタを駆動するものであって、前記スイッチ電圧よりもブートキャパシタの両端間電圧だけ高いブート電圧の印加端と前記スイッチ電圧の印加端との間に接続されたキャパシタ回路と、前記トランジスタのオン遷移時に前記入力電圧で前記トランジスタの入力ゲート容量をプリチャージしてから前記ブート電圧で前記入力ゲート容量をチャージし、前記トランジスタのオン遷移後に前記キャパシタ回路の容量値を引き下げるタイミング制御回路と、を有する。