CONSTRUCTION OF A BLOCK DEVICE

Disclosed embodiments relate to constructing an allocation of memory in a memory subsystem. In one example, a method includes receiving from a host system among a pool of host systems, a request to construct an allocation of memory, the pool of host systems being coupled to a pool of memory devices,...

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1. Verfasser: MAHESH, Ananda C. S
Format: Patent
Sprache:eng ; fre
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Beschreibung
Zusammenfassung:Disclosed embodiments relate to constructing an allocation of memory in a memory subsystem. In one example, a method includes receiving from a host system among a pool of host systems, a request to construct an allocation of memory, the pool of host systems being coupled to a pool of memory devices, selecting multiple memory devices among the pool of memory devices, selecting multiple memory components among the multiple memory devices, aggregating the multiple memory components to implement the allocation of memory, and providing, to the host system, hierarchical addresses to be used to access the multiple memory components implementing the allocation of memory, the hierarchical addresses each including a device ID of an associated memory device and a host ID of an associated host system. Des modes de réalisation divulgués concernent la construction d'une attribution de mémoire dans un sous-système de mémoire. Selon un exemple, un procédé consiste à recevoir, d'un système hôte parmi un groupe de systèmes hôtes, une requête de construction d'une attribution de mémoire, le groupe de systèmes hôtes étant couplé à un groupe de dispositifs de mémoire, à sélectionner de multiples dispositifs de mémoire parmi le groupe de dispositifs de mémoire, à sélectionner de multiples composants de mémoire parmi les multiples dispositifs de mémoire, à agréger les multiples composants de mémoire afin de mettre en œuvre l'attribution de mémoire, et à fournir, au système hôte, des adresses hiérarchiques à utiliser pour accéder aux multiples composants de mémoire mettant en œuvre l'attribution de mémoire, les adresses hiérarchiques comprenant chacune un ID de dispositif d'un dispositif de mémoire associé et un ID d'hôte d'un système hôte associé.