INFORMATION PROCESSING DEVICE AND INFORMATION PROCESSING SYSTEM
The present invention shortens the time taken for acquisition processing of a memory dump when a failure occurs. An information processing device is provided with a processor, a first storage unit, a control unit, and a second storage unit. The first storage unit functions as the primary storage of...
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Format: | Patent |
Sprache: | eng ; fre ; jpn |
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Zusammenfassung: | The present invention shortens the time taken for acquisition processing of a memory dump when a failure occurs. An information processing device is provided with a processor, a first storage unit, a control unit, and a second storage unit. The first storage unit functions as the primary storage of the processor. The control unit controls a first access to the first storage unit from the processor, a second access to the first storage unit executed asynchronous to the first access, and processing regarding acquisition of a memory dump. At the time of the second access, the second storage unit stores, based on an instruction from the control unit, a memory dump of data stored in the first storage unit.
La présente invention permet de réduire le temps consacré au traitement d'acquisition d'un vidage mémoire lors de l'occurrence d'une défaillance. Un dispositif de traitement d'informations comprend un processeur, une première unité de mémorisation, une unité de commande et une seconde unité de mémorisation. La première unité de mémorisation fonctionne en tant que mémoire principale du processeur. L'unité de commande commande un premier accès à la première unité de mémorisation depuis le processeur, un second accès à la première unité de mémorisation exécuté de manière asynchrone par rapport au premier accès et un traitement concernant l'acquisition d'un vidage mémoire. Au moment du second accès, la seconde unité de mémorisation mémorise, conformément à une instruction provenant de l'unité de commande, un vidage mémoire de données mémorisées dans la première unité de mémorisation.
障害発生時のメモリダンプの取得処理にかかる時間を短縮する。情報処理装置は、プロセッサ、第1の記憶部、制御部、第2の記憶部を備える。第1の記憶部は、プロセッサの主記憶として機能する。制御部は、プロセッサからの第1の記憶部への第1のアクセスと、第1のアクセスと同期せずに実行される第1の記憶部への第2のアクセスと、メモリダンプの取得に関する処理と、を制御する。第2の記憶部は、第2のアクセスの際に、制御部の指示により、第1の記憶部に記憶されているデータのメモリダンプを記憶する。 |
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