METHOD, APPARATUS, AND COMPUTER PROGRAM PRODUCT FOR INTER-CORE COMMUNICATION IN MULTI-CORE PROCESSORS
Method, apparatus, and computer program product embodiments of the invention are disclosed for efficient communication between processor units in a multi-core processor integrated circuit architecture. In example embodiments of the invention, a method comprises: storing with a shared inter-core comm...
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Format: | Patent |
Sprache: | eng ; fre |
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Zusammenfassung: | Method, apparatus, and computer program product embodiments of the invention are disclosed for efficient communication between processor units in a multi-core processor integrated circuit architecture. In example embodiments of the invention, a method comprises: storing with a shared inter-core communication unit in a multi-core processor, first data produced by a producer processor core, in a first token memory located at a first memory address of a memory address space; and connecting with the shared inter-core communication unit, the first token memory to a consumer processor core of the multi-core processor, to load the first data from the first token memory into the consumer processor core, in response to a first-type command from the producer processor core.
Des modes de réalisation de l'invention portent sur un procédé, un appareil et un produit programme d'ordinateur pour communication efficace entre des unités de processeur dans une architecture de circuit intégré à processeur multi-coeur. Dans des exemples de modes de réalisation de l'invention, un procédé consiste à : stocker, au moyen d'une unité de communication inter-coeur partagée dans un processeur multi-coeur, des premières données produites par un coeur de processeur producteur, dans une première mémoire de jeton se trouvant à une première adresse mémoire d'un espace d'adresse mémoire ; et connecter, au moyen de l'unité de communication inter-coeur partagée, la première mémoire de jeton à un coeur de processeur consommateur du processeur multi-coeur, afin de charger les premières données provenant de la première mémoire de jeton dans le coeur de processeur consommateur, en réponse à une instruction d'un premier type en provenance du coeur de processeur producteur. |
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