THIN-FILM TRANSISTOR, METHOD FOR PRODUCING SAME, AND DISPLAY ELEMENT
A semiconductor layer (40) is formed from an oxide semiconductor in which the width of a channel region (40a) is smaller than the widths of source and drain electrodes (60a, 60b) and the area of the side surface is enlarged. The semiconductor layer (40) is sandwiched between a gate insulating film (...
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Format: | Patent |
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Zusammenfassung: | A semiconductor layer (40) is formed from an oxide semiconductor in which the width of a channel region (40a) is smaller than the widths of source and drain electrodes (60a, 60b) and the area of the side surface is enlarged. The semiconductor layer (40) is sandwiched between a gate insulating film (30) and a passivation film (90) and is subjected to annealing in an atmosphere containing oxygen. As a consequence, external oxygen and the oxygen contained in the gate insulating film (30) and the passivation film (90) are supplied to the channel region (40a), the areas of low-resistance regions (40b) become small, and the region sandwiched by the two low-resistance regions (40b) becomes a high-resistance region (40c). Meanwhile, the contact resistance between the semiconductor layer (40) and the source and drain electrodes (60a, 60b) are kept low. As a result, the on and off ratio becomes large and suitable transistor properties are obtained.
Une couche semi-conductrice (40) est formée à partir d'un semi-conducteur oxyde dans lequel la largeur d'une zone de canal (40a) est inférieure aux largeurs d'électrodes de source et de drain (60a, 60b) et l'aire de la surface latérale est élargie. La couche semi-conductrice (40) est intercalée entre une pellicule d'isolation de gâchette (30) et une pellicule de passivation (90) et est soumise à un recuit dans une atmosphère contenant de l'oxygène. En conséquence, l'oxygène externe et l'oxygène contenu dans la pellicule d'isolation de gâchette (30) et la pellicule de passivation (90) sont fournis à la zone de canal (40a), les aires de zones à faible résistance (40b) deviennent petites, et la zone intercalée entre les deux zones à faible résistance (40b) devient une zone à résistance élevée (40c). En même temps, la résistance de contact entre la couche semi-conductrice (40) et les électrodes de source et de drain (60a, 60b) est maintenue basse. Ainsi, le ratio d'activation et de désactivation devient large et des propriétés de transistor convenables sont obtenues. |
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