CIRCUIT AND METHOD FOR GENERATING A TRUE, CIRCUIT-SPECIFIC AND TIME-INVARIANT RANDOM NUMBER
Die Erfindung betrifft eine Schaltung zur Erzeugung einer echten, schaltungsspezifischen und zeitinvarianten binären Zufallszahl mit: einer Matrix von K-L Verzögerungselementen, die mittels L-1 einfachen oder zweifachen Kommutationsschaltungen miteinander zu Ketten von Verzögerungselementen der Läng...
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|---|---|
| Format: | Patent |
| Sprache: | eng ; fre ; ger |
| Schlagworte: | |
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| creator | LAZICH, DEJAN KALUZA, SEBASTIAN WUENSCHE, MICAELA |
| description | Die Erfindung betrifft eine Schaltung zur Erzeugung einer echten, schaltungsspezifischen und zeitinvarianten binären Zufallszahl mit: einer Matrix von K-L Verzögerungselementen, die mittels L-1 einfachen oder zweifachen Kommutationsschaltungen miteinander zu Ketten von Verzögerungselementen der Länge L verschaltbar sind, einem vor die Matrix geschalteten einfachen oder zweifachen Demultiplexer, einem hinter die Matrix geschalteten einfachen oder zweifachen Multiplexer, und einem Laufzeit- oder Zahlenkomparator, wobei die Stellung der Kommutationsschaltungen, des Demultiplexers und des Multiplexers durch ein Steuersignal vorgebbar ist, wobei die Schaltung einen Kanalcode-Codierer, mit dem Codeworte eines Kanalcodes erzeugbar sind, und einen Umcodierer, mit dem Codeworte des Kanalcodes zum Steuersignal der L-1 einfachen oder zweifachen Kommutationsschaltungen umcodierbar sind, aufweist und ein Verfahren zur Erzeugung einer echten, schaltungsspezifischen und zeitinvarianten Zufallszahl mittels einer Matrix von L-K Verzögerungselementen, L-1 einfachen oder zweifachen Kommutationsschaltungen, eines vor die Matrix geschalteten einfachen oder zweifachen Demultiplexers, eines hinter die Matrix geschalteten einfachen oder zweifachen Multiplexer, und eines Laufzeit- oder Zahlenkomparators, aufweisend zumindest die Schritte a) Erzeugen eines Codewortes eines Kanalcodes, b) Umcodieren eines Codewortes eines Kanalcodes zu einem Auswahlcode, c) Erzeugen von Ketten von L Verzögerungselementen durch Einstellen einer dem Codewort des Äuswahlcodes entsprechenden Einstellung der L-1 einfachen oder zweifachen Kommutationsschaltungen, des einfachen oder zweifachen Demultiplexers und des einfachen oder zweifachen Multiplexers, d) paarweises Vergleichen von durch die Verzögerungszeiten von zwei durch die dem Codewort des Kanalcodes entsprechende Einstellung der L-1 Kommutationsschaltungen definierten Ketten von L Verzögerungselementen bestimmten Größen mittels eines Zahlen- oder Verzögerungskomparators zur Erzeugung eines Bits der echten, schaltungsspezifischen und zeitinvarianten Zufallszahl.
The invention relates to a circuit for generating a true, circuit-specific and time-invariant random binary number, having: a matrix of K-L delay elements that can be connected to each other by means of L-1 single or double commutation circuits into chains of delay elements of length L, a single or double demultiplexer connected before the matrix, a single or double multiplexer connection |
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The invention relates to a circuit for generating a true, circuit-specific and time-invariant random binary number, having: a matrix of K-L delay elements that can be connected to each other by means of L-1 single or double commutation circuits into chains of delay elements of length L, a single or double demultiplexer connected before the matrix, a single or double multiplexer connection after the matrix, and a run time or number comparator, wherein the setting of the commutation circuits, the demultiplexer, and the multiplexer can be prescribed by a control signal, wherein the circuit comprises a channel code encoder whereby code words of a channel code can be generated and a transcriber, whereby code words of the channel code can be transcribed into the control signal of the L-1 single or double commutation circuits, and a method for generating a true, circuit-specific and time-invariant random number by means of a matrix of L-K delay elements, L-1 single or double commutation circuits, a single or double demultiplexer connected before the matrix, a single or double multiplexer connection after the matrix, and a run time or number comparator, comprising at least the steps a) generating a code word of a channel code, b) transcribing a code word of a channel code to a selection code, c) generating chains of L delay elements by setting a setting corresponding to the code word of the selection code for the L-1 single or double commutation circuits, the single or double demultiplexer, and the single or double multiplexer, d) pairwise comparing of two variables determined by the delay times of two chains defined by the setting of the L-1 commutation circuits corresponding to the code word of the channel code, by means of a number or delay comparator for generating a bit of the true, circuit-specific and time-invariant random number.
L'invention concerne un montage électrique pour générer un vrai nombre aléatoire, spécifique du montage et non variable dans le temps, comportant : une matrice de K-L éléments de temporisation qui, au moyen de L-1 circuits de commutation simples ou doubles, peuvent être reliés entre eux en chaînes d'éléments de temporisation de longueur L ; un démultiplexeur simple ou double, monté avant la matrice; un multiplexeur simple ou double, monté après la matrice ; et un comparateur de temps de propagation ou de nombres. Sachant que la position des circuits de commutation, du démultiplexeur et du multiplexeur peut être prédéterminée par un signal de commande, et que le montage présente : un codeur de code de canal, qui permet de générer des mots de code d'un code de canal ; et un transcodeur, avec lequel les mots de code du signal de canal peuvent être transcodés pour former le signal de commande des L-1 circuits de commutation simples ou doubles. L'invention concerne également un procédé pour générer un vrai nombre aléatoire, spécifique du montage et non variable dans le temps, au moyen d'une matrice de L-K éléments de temporisation de L-1 circuits de commutation simples ou doubles, d'un démultiplexeur simple ou double monté avant la matrice, d'un multiplexeur simple ou double monté après la matrice, et d'un comparateur de temps de propagation ou de nombres. Ce procédé présente au moins les étapes suivantes : a) production d'un mot de code d'un code de canal ; b) transcodage d'un mot de code d'un code de canal en un code de sélection ; c) production de chaînes de L éléments de temporisation en réglant un réglage, correspondant au mot de code du code de sélection, des L-1 circuits de commutation simples ou doubles, du démultiplexeur simple ou double et du multiplexeur simple ou double ; d) au moyen d'un comparateur de nombres ou de temporisation et afin de générer un bit du vrai nombre aléatoire spécifique du montage et non variable dans le temps, comparaison par paires des durées de temporisation de deux chaînes de L éléments de temporisation de tailles données, chaînes qui sont définies par le réglage, correspondant au mot de code du code de canal, des L-1 circuits de commutation.</description><language>eng ; fre ; ger</language><subject>CALCULATING ; COMPUTING ; COUNTING ; ELECTRIC DIGITAL DATA PROCESSING ; PHYSICS</subject><creationdate>2009</creationdate><oa>free_for_read</oa><woscitedreferencessubscribed>false</woscitedreferencessubscribed></display><links><openurl>$$Topenurl_article</openurl><openurlfulltext>$$Topenurlfull_article</openurlfulltext><thumbnail>$$Tsyndetics_thumb_exl</thumbnail><linktohtml>$$Uhttps://worldwide.espacenet.com/publicationDetails/biblio?FT=D&date=20090716&DB=EPODOC&CC=WO&NR=2009086878A1$$EHTML$$P50$$Gepo$$Hfree_for_read</linktohtml><link.rule.ids>230,308,780,885,25564,76547</link.rule.ids><linktorsrc>$$Uhttps://worldwide.espacenet.com/publicationDetails/biblio?FT=D&date=20090716&DB=EPODOC&CC=WO&NR=2009086878A1$$EView_record_in_European_Patent_Office$$FView_record_in_$$GEuropean_Patent_Office$$Hfree_for_read</linktorsrc></links><search><creatorcontrib>LAZICH, DEJAN</creatorcontrib><creatorcontrib>KALUZA, SEBASTIAN</creatorcontrib><creatorcontrib>WUENSCHE, MICAELA</creatorcontrib><title>CIRCUIT AND METHOD FOR GENERATING A TRUE, CIRCUIT-SPECIFIC AND TIME-INVARIANT RANDOM NUMBER</title><description>Die Erfindung betrifft eine Schaltung zur Erzeugung einer echten, schaltungsspezifischen und zeitinvarianten binären Zufallszahl mit: einer Matrix von K-L Verzögerungselementen, die mittels L-1 einfachen oder zweifachen Kommutationsschaltungen miteinander zu Ketten von Verzögerungselementen der Länge L verschaltbar sind, einem vor die Matrix geschalteten einfachen oder zweifachen Demultiplexer, einem hinter die Matrix geschalteten einfachen oder zweifachen Multiplexer, und einem Laufzeit- oder Zahlenkomparator, wobei die Stellung der Kommutationsschaltungen, des Demultiplexers und des Multiplexers durch ein Steuersignal vorgebbar ist, wobei die Schaltung einen Kanalcode-Codierer, mit dem Codeworte eines Kanalcodes erzeugbar sind, und einen Umcodierer, mit dem Codeworte des Kanalcodes zum Steuersignal der L-1 einfachen oder zweifachen Kommutationsschaltungen umcodierbar sind, aufweist und ein Verfahren zur Erzeugung einer echten, schaltungsspezifischen und zeitinvarianten Zufallszahl mittels einer Matrix von L-K Verzögerungselementen, L-1 einfachen oder zweifachen Kommutationsschaltungen, eines vor die Matrix geschalteten einfachen oder zweifachen Demultiplexers, eines hinter die Matrix geschalteten einfachen oder zweifachen Multiplexer, und eines Laufzeit- oder Zahlenkomparators, aufweisend zumindest die Schritte a) Erzeugen eines Codewortes eines Kanalcodes, b) Umcodieren eines Codewortes eines Kanalcodes zu einem Auswahlcode, c) Erzeugen von Ketten von L Verzögerungselementen durch Einstellen einer dem Codewort des Äuswahlcodes entsprechenden Einstellung der L-1 einfachen oder zweifachen Kommutationsschaltungen, des einfachen oder zweifachen Demultiplexers und des einfachen oder zweifachen Multiplexers, d) paarweises Vergleichen von durch die Verzögerungszeiten von zwei durch die dem Codewort des Kanalcodes entsprechende Einstellung der L-1 Kommutationsschaltungen definierten Ketten von L Verzögerungselementen bestimmten Größen mittels eines Zahlen- oder Verzögerungskomparators zur Erzeugung eines Bits der echten, schaltungsspezifischen und zeitinvarianten Zufallszahl.
The invention relates to a circuit for generating a true, circuit-specific and time-invariant random binary number, having: a matrix of K-L delay elements that can be connected to each other by means of L-1 single or double commutation circuits into chains of delay elements of length L, a single or double demultiplexer connected before the matrix, a single or double multiplexer connection after the matrix, and a run time or number comparator, wherein the setting of the commutation circuits, the demultiplexer, and the multiplexer can be prescribed by a control signal, wherein the circuit comprises a channel code encoder whereby code words of a channel code can be generated and a transcriber, whereby code words of the channel code can be transcribed into the control signal of the L-1 single or double commutation circuits, and a method for generating a true, circuit-specific and time-invariant random number by means of a matrix of L-K delay elements, L-1 single or double commutation circuits, a single or double demultiplexer connected before the matrix, a single or double multiplexer connection after the matrix, and a run time or number comparator, comprising at least the steps a) generating a code word of a channel code, b) transcribing a code word of a channel code to a selection code, c) generating chains of L delay elements by setting a setting corresponding to the code word of the selection code for the L-1 single or double commutation circuits, the single or double demultiplexer, and the single or double multiplexer, d) pairwise comparing of two variables determined by the delay times of two chains defined by the setting of the L-1 commutation circuits corresponding to the code word of the channel code, by means of a number or delay comparator for generating a bit of the true, circuit-specific and time-invariant random number.
L'invention concerne un montage électrique pour générer un vrai nombre aléatoire, spécifique du montage et non variable dans le temps, comportant : une matrice de K-L éléments de temporisation qui, au moyen de L-1 circuits de commutation simples ou doubles, peuvent être reliés entre eux en chaînes d'éléments de temporisation de longueur L ; un démultiplexeur simple ou double, monté avant la matrice; un multiplexeur simple ou double, monté après la matrice ; et un comparateur de temps de propagation ou de nombres. Sachant que la position des circuits de commutation, du démultiplexeur et du multiplexeur peut être prédéterminée par un signal de commande, et que le montage présente : un codeur de code de canal, qui permet de générer des mots de code d'un code de canal ; et un transcodeur, avec lequel les mots de code du signal de canal peuvent être transcodés pour former le signal de commande des L-1 circuits de commutation simples ou doubles. L'invention concerne également un procédé pour générer un vrai nombre aléatoire, spécifique du montage et non variable dans le temps, au moyen d'une matrice de L-K éléments de temporisation de L-1 circuits de commutation simples ou doubles, d'un démultiplexeur simple ou double monté avant la matrice, d'un multiplexeur simple ou double monté après la matrice, et d'un comparateur de temps de propagation ou de nombres. Ce procédé présente au moins les étapes suivantes : a) production d'un mot de code d'un code de canal ; b) transcodage d'un mot de code d'un code de canal en un code de sélection ; c) production de chaînes de L éléments de temporisation en réglant un réglage, correspondant au mot de code du code de sélection, des L-1 circuits de commutation simples ou doubles, du démultiplexeur simple ou double et du multiplexeur simple ou double ; d) au moyen d'un comparateur de nombres ou de temporisation et afin de générer un bit du vrai nombre aléatoire spécifique du montage et non variable dans le temps, comparaison par paires des durées de temporisation de deux chaînes de L éléments de temporisation de tailles données, chaînes qui sont définies par le réglage, correspondant au mot de code du code de canal, des L-1 circuits de commutation.</description><subject>CALCULATING</subject><subject>COMPUTING</subject><subject>COUNTING</subject><subject>ELECTRIC DIGITAL DATA PROCESSING</subject><subject>PHYSICS</subject><fulltext>true</fulltext><rsrctype>patent</rsrctype><creationdate>2009</creationdate><recordtype>patent</recordtype><sourceid>EVB</sourceid><recordid>eNqNi7EKwjAQQLs4iPoPB64WqoLGMaaX9oYkcr3o4FCKxEm0UP8fRfoBTg8e702zqyE2kQS0L8Gh1KEEGxgq9MhayFegQTjiCsYyb05oyJL5LUIOc_JnzaS9AH9dcOCjOyLPs8m9ewxpMXKWLS2KqfPUv9o09N0tPdO7vYRNURwKtVN7pdfb_6oPFcsyvA</recordid><startdate>20090716</startdate><enddate>20090716</enddate><creator>LAZICH, DEJAN</creator><creator>KALUZA, SEBASTIAN</creator><creator>WUENSCHE, MICAELA</creator><scope>EVB</scope></search><sort><creationdate>20090716</creationdate><title>CIRCUIT AND METHOD FOR GENERATING A TRUE, CIRCUIT-SPECIFIC AND TIME-INVARIANT RANDOM NUMBER</title><author>LAZICH, DEJAN ; KALUZA, SEBASTIAN ; WUENSCHE, MICAELA</author></sort><facets><frbrtype>5</frbrtype><frbrgroupid>cdi_FETCH-epo_espacenet_WO2009086878A13</frbrgroupid><rsrctype>patents</rsrctype><prefilter>patents</prefilter><language>eng ; fre ; ger</language><creationdate>2009</creationdate><topic>CALCULATING</topic><topic>COMPUTING</topic><topic>COUNTING</topic><topic>ELECTRIC DIGITAL DATA PROCESSING</topic><topic>PHYSICS</topic><toplevel>online_resources</toplevel><creatorcontrib>LAZICH, DEJAN</creatorcontrib><creatorcontrib>KALUZA, SEBASTIAN</creatorcontrib><creatorcontrib>WUENSCHE, MICAELA</creatorcontrib><collection>esp@cenet</collection></facets><delivery><delcategory>Remote Search Resource</delcategory><fulltext>fulltext_linktorsrc</fulltext></delivery><addata><au>LAZICH, DEJAN</au><au>KALUZA, SEBASTIAN</au><au>WUENSCHE, MICAELA</au><format>patent</format><genre>patent</genre><ristype>GEN</ristype><title>CIRCUIT AND METHOD FOR GENERATING A TRUE, CIRCUIT-SPECIFIC AND TIME-INVARIANT RANDOM NUMBER</title><date>2009-07-16</date><risdate>2009</risdate><abstract>Die Erfindung betrifft eine Schaltung zur Erzeugung einer echten, schaltungsspezifischen und zeitinvarianten binären Zufallszahl mit: einer Matrix von K-L Verzögerungselementen, die mittels L-1 einfachen oder zweifachen Kommutationsschaltungen miteinander zu Ketten von Verzögerungselementen der Länge L verschaltbar sind, einem vor die Matrix geschalteten einfachen oder zweifachen Demultiplexer, einem hinter die Matrix geschalteten einfachen oder zweifachen Multiplexer, und einem Laufzeit- oder Zahlenkomparator, wobei die Stellung der Kommutationsschaltungen, des Demultiplexers und des Multiplexers durch ein Steuersignal vorgebbar ist, wobei die Schaltung einen Kanalcode-Codierer, mit dem Codeworte eines Kanalcodes erzeugbar sind, und einen Umcodierer, mit dem Codeworte des Kanalcodes zum Steuersignal der L-1 einfachen oder zweifachen Kommutationsschaltungen umcodierbar sind, aufweist und ein Verfahren zur Erzeugung einer echten, schaltungsspezifischen und zeitinvarianten Zufallszahl mittels einer Matrix von L-K Verzögerungselementen, L-1 einfachen oder zweifachen Kommutationsschaltungen, eines vor die Matrix geschalteten einfachen oder zweifachen Demultiplexers, eines hinter die Matrix geschalteten einfachen oder zweifachen Multiplexer, und eines Laufzeit- oder Zahlenkomparators, aufweisend zumindest die Schritte a) Erzeugen eines Codewortes eines Kanalcodes, b) Umcodieren eines Codewortes eines Kanalcodes zu einem Auswahlcode, c) Erzeugen von Ketten von L Verzögerungselementen durch Einstellen einer dem Codewort des Äuswahlcodes entsprechenden Einstellung der L-1 einfachen oder zweifachen Kommutationsschaltungen, des einfachen oder zweifachen Demultiplexers und des einfachen oder zweifachen Multiplexers, d) paarweises Vergleichen von durch die Verzögerungszeiten von zwei durch die dem Codewort des Kanalcodes entsprechende Einstellung der L-1 Kommutationsschaltungen definierten Ketten von L Verzögerungselementen bestimmten Größen mittels eines Zahlen- oder Verzögerungskomparators zur Erzeugung eines Bits der echten, schaltungsspezifischen und zeitinvarianten Zufallszahl.
The invention relates to a circuit for generating a true, circuit-specific and time-invariant random binary number, having: a matrix of K-L delay elements that can be connected to each other by means of L-1 single or double commutation circuits into chains of delay elements of length L, a single or double demultiplexer connected before the matrix, a single or double multiplexer connection after the matrix, and a run time or number comparator, wherein the setting of the commutation circuits, the demultiplexer, and the multiplexer can be prescribed by a control signal, wherein the circuit comprises a channel code encoder whereby code words of a channel code can be generated and a transcriber, whereby code words of the channel code can be transcribed into the control signal of the L-1 single or double commutation circuits, and a method for generating a true, circuit-specific and time-invariant random number by means of a matrix of L-K delay elements, L-1 single or double commutation circuits, a single or double demultiplexer connected before the matrix, a single or double multiplexer connection after the matrix, and a run time or number comparator, comprising at least the steps a) generating a code word of a channel code, b) transcribing a code word of a channel code to a selection code, c) generating chains of L delay elements by setting a setting corresponding to the code word of the selection code for the L-1 single or double commutation circuits, the single or double demultiplexer, and the single or double multiplexer, d) pairwise comparing of two variables determined by the delay times of two chains defined by the setting of the L-1 commutation circuits corresponding to the code word of the channel code, by means of a number or delay comparator for generating a bit of the true, circuit-specific and time-invariant random number.
L'invention concerne un montage électrique pour générer un vrai nombre aléatoire, spécifique du montage et non variable dans le temps, comportant : une matrice de K-L éléments de temporisation qui, au moyen de L-1 circuits de commutation simples ou doubles, peuvent être reliés entre eux en chaînes d'éléments de temporisation de longueur L ; un démultiplexeur simple ou double, monté avant la matrice; un multiplexeur simple ou double, monté après la matrice ; et un comparateur de temps de propagation ou de nombres. Sachant que la position des circuits de commutation, du démultiplexeur et du multiplexeur peut être prédéterminée par un signal de commande, et que le montage présente : un codeur de code de canal, qui permet de générer des mots de code d'un code de canal ; et un transcodeur, avec lequel les mots de code du signal de canal peuvent être transcodés pour former le signal de commande des L-1 circuits de commutation simples ou doubles. L'invention concerne également un procédé pour générer un vrai nombre aléatoire, spécifique du montage et non variable dans le temps, au moyen d'une matrice de L-K éléments de temporisation de L-1 circuits de commutation simples ou doubles, d'un démultiplexeur simple ou double monté avant la matrice, d'un multiplexeur simple ou double monté après la matrice, et d'un comparateur de temps de propagation ou de nombres. Ce procédé présente au moins les étapes suivantes : a) production d'un mot de code d'un code de canal ; b) transcodage d'un mot de code d'un code de canal en un code de sélection ; c) production de chaînes de L éléments de temporisation en réglant un réglage, correspondant au mot de code du code de sélection, des L-1 circuits de commutation simples ou doubles, du démultiplexeur simple ou double et du multiplexeur simple ou double ; d) au moyen d'un comparateur de nombres ou de temporisation et afin de générer un bit du vrai nombre aléatoire spécifique du montage et non variable dans le temps, comparaison par paires des durées de temporisation de deux chaînes de L éléments de temporisation de tailles données, chaînes qui sont définies par le réglage, correspondant au mot de code du code de canal, des L-1 circuits de commutation.</abstract><oa>free_for_read</oa></addata></record> |
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