HARDWARE UNIT FOR PARSING AN XML DOCUMENT
A hardware unit for parsing an XML document includes embedded logic or circuitry for accessing the document, decoding it to change a character set, validating individual characters of the document, extracting tokens, maintaining a symbol table and generating binary token headers to describe the docu...
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Format: | Patent |
Sprache: | eng ; fre |
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Zusammenfassung: | A hardware unit for parsing an XML document includes embedded logic or circuitry for accessing the document, decoding it to change a character set, validating individual characters of the document, extracting tokens, maintaining a symbol table and generating binary token headers to describe the document's structure and convey the document's data to an application. Tokenization, the process of identifying tokens and generating token headers, may be controlled by a finite state machine that recognizes XML delimiters in the document's markup and activates state transitions based on the current state and the recognized delimiter. The parser unit may be implemented within a hardware XML accelerator that includes a processor, a DMA engine, a cryptographic engine, memory (e.g., for storing a document, maintaining a symbol table) and various interfaces (e.g., network, memory, bus).
La présente invention a trait à une unité matérielle pour l'analyse d'un document en langage XML comportant une logique ou un circuit incorporé(e) pour l'accès au document, son décodage pour modifier un jeu de caractères, la validation de caractères individuels du document, l'extraction de jetons d'authentification, la tenue d'une table de symboles et la génération d'en-têtes de jetons binaires pour décrire la structure du document et le transport des données du document sur une application. L'extraction de jetons d'authentification, le traitement d'identification de jetons et la génération d'en-têtes de jetons peuvent être contrôlés par une machine d'états-finis qui reconnaît des délimiteurs de langage XML dans la balise du document et assure l'activation de transitions d'états en fonction de l'état courant et du délimiteur reconnu. L'unité d'analyse peut être mise en oeuvre au sein d'un accélérateur XML comprenant un processeur, un moteur d'accès direct en mémoire, un moteur cryptographique, une mémoire (par exemple, pour le stockage d'un document, la tenue d'une table de symboles) et diverses interfaces (par exemple, un réseau, une mémoire, un bus). |
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