METHOD OF DECODING A TURBO PRODUCT CODE UTILIZING A SCALABLE AND HARDWARE EFFICIENT FORWARD ERROR CORRECTION DECODER

A method and apparatus for decoding a codeword having a plurality of bits, wherein each bit includes a soft value. The apparatus includes a plurality of bit cells (10) arranged in a first array (100). Stored within each bit cell is the soft value for a corresponding bit of the codeword. The apparatu...

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Bibliographische Detailangaben
Hauptverfasser: DEARIEN, JASON, A, COULTER, EDWARD, R, GENTLE, PETER, JONES, ANTHONY, M, WALKER, CHRIS, CASEBOLT, DAVID, J, WASSON, PAUL, FRANKLIN, JASON, G, HUNGERFORD, NATHAN, J, DANIELSON, ALAN, R
Format: Patent
Sprache:eng ; fre
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Beschreibung
Zusammenfassung:A method and apparatus for decoding a codeword having a plurality of bits, wherein each bit includes a soft value. The apparatus includes a plurality of bit cells (10) arranged in a first array (100). Stored within each bit cell is the soft value for a corresponding bit of the codeword. The apparatus also includes a controller module (106) coupled to the first array. The controller module performs a component decode on each soft value in the plurality of bit cell, rotating the soft values between each of the bit cells along the first array by using a connection scheme (110). A method and apparatus for decoding an encoded codeword having a plurality of bits, wherein each of the plurality of bits includes a soft value, the decoder comprising: a plurality of bit cells arranged in a first array, wherein each bit cell stores the soft value within for a corresponding bit; and a controller module coupled to the first array of bit cells, the controller module for performing a component decode on each soft value in the plurality of bit cell, wherein the controller module rotates the soft values between each of the bit cells along the first array using a connection scheme. L'invention concerne un procédé et un appareil permettant de décoder un mot codé comprenant une pluralité de bits, chacun des bits renfermant une valeur logique et le décodeur comprenant: une pluralité de cellules binaires disposées dans un premier réseau, chaque cellule stockant la valeur logique dans un bit correspondant; ainsi qu'un module de commande couplé au premier réseau de cellules binaires et exécutant un décodage de composant sur chaque valeur logique dans la pluralité de cellules binaires, le module de commande soumettant les valeurs logiques à une rotation entre chaque cellule binaire, le long du premier réseau, au moyen d'un schéma de connexion.