ФОРМУВАЧ ПЕРІОДИЧНОЇ ПОСЛІДОВНОСТІ З ПЕРЕНАСТРОЮВАНОЮ ТРИВАЛІСТЮ ІМПУЛЬСІВ І ПАУЗИ І ПРОГРАМОВАНОЮ ЗАТРИМКОЮ ПОЧАТКУ ФОРМУВАННЯ ВІДНОСНО СТАРТОВОГО ІМПУЛЬСУ
Формувач періодичної послідовності з перенастроюваною тривалістю імпульсів і паузи і програмованою затримкою початку формування відносно стартового імпульсу містить два двійкових лічильники, перший з яких реверсивний, налагоджений на режим віднімання, що має вхід подачі імпульсів синхронізації, вхід...
Gespeichert in:
Hauptverfasser: | , |
---|---|
Format: | Patent |
Sprache: | ukr |
Schlagworte: | |
Online-Zugang: | Volltext bestellen |
Tags: |
Tag hinzufügen
Keine Tags, Fügen Sie den ersten Tag hinzu!
|
Zusammenfassung: | Формувач періодичної послідовності з перенастроюваною тривалістю імпульсів і паузи і програмованою затримкою початку формування відносно стартового імпульсу містить два двійкових лічильники, перший з яких реверсивний, налагоджений на режим віднімання, що має вхід подачі імпульсів синхронізації, вхід дозволу синхронного паралельного завантаження і входи подачі даних при завантаженні, вхід дозволу режиму лічби, вхід асинхронної установки у нульовий стан, вихід переповнювання; інвертор; ланцюжок, що складається з послідовно з'єднаних резистора і конденсатора, підключеного до джерела живлення; стартостопний пристрій, який містить синхронний D-тригер зі входом асинхронної установки у нульовий стан, перший і другий двовходові елементи І; перший, другий і третій елементи АБО, при цьому перший вхід першого елемента АБО з'єднано з виходом D-тригера; вихід першого елемента АБО з'єднано з першим входом другого елемента І; загальна точка послідовно сполучених резистора і конденсатора з'єднана з інформаційним входом D-тригера, з одним входом першого та другим входом другого елементів І; вихід першого елемента І сполучений зі входом асинхронної установки D-тригера в нульовий стан; вихід другого елемента І з'єднаний зі входами асинхронної установки лічильників у нульовий стан; тактові входи лічильників утворюють вхід формувача; входи паралельного завантаження першого лічильника утворюють входи налагодження формувача на задані часові параметри вихідних імпульсів, крім того введено одноадресний мультиплексор, а другий лічильник виконаний однорозрядним; виходи другого, третього і четвертого розрядів першого лічильника з'єднано зі входами третього елемента АБО, вихід якого з'єднано з другим входом другого елемента АБО і входом дозволу синхронного завантаження першого лічильника, прямий вихід другого D - тригера, який утворює вихід формувача, з'єднано з другим входом першого елемента АБО. |
---|