프로세서에서 칩렛을 구성하기 위한 칩렛 레벨 성능 정보 사용

프로세서는 제어기, 및 각 칩렛이 복수의 프로세서 코어들을 포함하는, 복수의 칩렛들을 포함한다. 제어기는 해당 칩렛 상의 프로세서 코어들의 지정된 세트들에 대한 복수의 성능 레벨들 각각에서의 각 칩렛의 성능을 식별하는 칩렛들에 대한 칩렛 레벨 성능 정보를 제공한다. 제어기는 주어진 성능 레벨로 지정된 수의 프로세서 코어가 구성될 복수의 칩렛들 중으로부터 하나 이상의 선택된 칩렛 - 하나 이상의 선택된 칩렛은 칩렛 레벨 성능 정보 및 성능 요건들에 기초하여 선택됨 - 의 식별 정보를 수신한다. 제어기는 주어진 성능 레벨로 하나 이상의...

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Hauptverfasser: ECKERT YASUKO, GUTIERREZ ANTHONY, BHARADWAJ VEDULA VENKATA SRIKANT, GANAPATHY SHRIKANTH, SANGAIAH KARTHIK RAMU
Format: Patent
Sprache:kor
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Beschreibung
Zusammenfassung:프로세서는 제어기, 및 각 칩렛이 복수의 프로세서 코어들을 포함하는, 복수의 칩렛들을 포함한다. 제어기는 해당 칩렛 상의 프로세서 코어들의 지정된 세트들에 대한 복수의 성능 레벨들 각각에서의 각 칩렛의 성능을 식별하는 칩렛들에 대한 칩렛 레벨 성능 정보를 제공한다. 제어기는 주어진 성능 레벨로 지정된 수의 프로세서 코어가 구성될 복수의 칩렛들 중으로부터 하나 이상의 선택된 칩렛 - 하나 이상의 선택된 칩렛은 칩렛 레벨 성능 정보 및 성능 요건들에 기초하여 선택됨 - 의 식별 정보를 수신한다. 제어기는 주어진 성능 레벨로 하나 이상의 선택된 칩렛의 지정된 수의 프로세서 코어를 구성한다. 그런 다음, 주어진 성능 레벨로 하나 이상의 선택된 칩렛의 지정된 수의 프로세서 코어 상에서 태스크가 실행된다. A processor includes a controller and plurality of chiplets, each chiplet including a plurality of processor cores. The controller provides chiplet-level performance information for the chiplets that identifies a performance of each chiplet at each of a plurality of performance levels for specified sets of processor cores on that chiplet. The controller receives an identification of one or more selected chiplets from among the plurality of chiplets for which a specified number of processor cores are to be configured at a given performance level, the one or more selected chiplets having been selected based on the chiplet-level performance information and performance requirements. The controller configures the specified number of processor cores of the one or more selected chiplets at the given performance level. A task is then run on the specified number of processor cores of the one or more selected chiplets at the given performance level.