SEMICONDUCTOR PACKAGE AND METHOD OF FABRICATING THE SAME
반도체 패키지 및 그 제조 방법에 제공된다. 반도체 패키지는 서로 오버랩되지 않는 제1 영역 및 제2 영역을 갖는 제1 패키지 기판, 제1 영역상에 배치되고, 제1 높이를 갖는 제1 접속 소자, 제1 접속 소자에 접속되고, 제2 높이를 갖는 제1 반도체 칩, 제2 영역상에 배치되고, 제3 높이를 갖는 제2 접속 소자, 제2 접속 소자상에 배치되고, 제2 접속 소자와 전기적으로 연결되고, 제4 높이를 갖는 제3 접속 소자, 제3 접속 소자상에 배치되고, 제2 패키지 기판 및 제2 반도체 칩을 포함하는 제2 패키지, 및 제1 반도체 칩...
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|---|---|
| Format: | Patent |
| Sprache: | eng ; kor |
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| Zusammenfassung: | 반도체 패키지 및 그 제조 방법에 제공된다. 반도체 패키지는 서로 오버랩되지 않는 제1 영역 및 제2 영역을 갖는 제1 패키지 기판, 제1 영역상에 배치되고, 제1 높이를 갖는 제1 접속 소자, 제1 접속 소자에 접속되고, 제2 높이를 갖는 제1 반도체 칩, 제2 영역상에 배치되고, 제3 높이를 갖는 제2 접속 소자, 제2 접속 소자상에 배치되고, 제2 접속 소자와 전기적으로 연결되고, 제4 높이를 갖는 제3 접속 소자, 제3 접속 소자상에 배치되고, 제2 패키지 기판 및 제2 반도체 칩을 포함하는 제2 패키지, 및 제1 반도체 칩 및 제2 접속 소자의 적어도 일부를 덮고, 제1 패키지 기판을 덮고, 제1 반도체 칩 및 제2 접속 소자의 상면을 노출하고, 제5 높이를 갖는 제1 몰드막을 포함한다. |
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