LIGHT EMITTING DISPLAY DEVICE
The present invention relates to a light-emitting display device capable of improving display quality. According to embodiments of the present invention, the light emitting display device includes: a substrate; a first semiconductor layer positioned on the substrate; a first gate insulation layer po...
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Format: | Patent |
Sprache: | eng ; kor |
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Zusammenfassung: | The present invention relates to a light-emitting display device capable of improving display quality. According to embodiments of the present invention, the light emitting display device includes: a substrate; a first semiconductor layer positioned on the substrate; a first gate insulation layer positioned on the first semiconductor layer; a first gate conduction layer positioned on the first gate insulation layer; a second gate insulation layer positioned on the first gate conduction layer; a first data conduction layer positioned on the second gate insulation layer; a first organic layer positioned on the first data conduction layer; a second data conduction layer positioned on the first organic layer and including a first anode connection member and a second anode connection member; a second organic layer and a third organic layer, positioned on the second data conduction layer; a first anode and a second anode, positioned on the third organic layer; and a black pixel-defining layer including a first opening and a second opening individually exposing the first anode and the second anode. The second organic layer and the third organic layer include a first anode connection opening and a second anode connection opening, which individually connect the first anode and the second anode to the first anode connection member and the second anode connection member. A center line passing the first anode connection opening or the center thereof and the second anode connection opening or the center thereof passes through the center of the first opening or the center of the second opening.
실시예들에 따르면, 발광 표시 장치는 기판; 상기 기판 위에 위치하는 제1 반도체층; 상기 반도체층 위에 위치하는 제1 게이트 절연막; 상기 제1 게이트 절연막 위에 위치하는 제1 게이트 도전층; 상기 제1 게이트 도전층 위에 위치하는 제2 게이트 절연막; 상기 제2 게이트 절연막 위에 위치하는 제1 데이터 도전층; 상기 제1 데이터 도전층 위에 위치하는 제1 유기막; 상기 제1 유기막 위에 위치하며, 제1 애노드 연결 부재 및 제2 애노드 연결 부재를 포함하는 제2 데이터 도전층; 상기 제2 데이터 도전층위에 위치하는 제2 유기막 및 제3 유기막; 상기 제3 유기막 위에 위치하는 제1 애노드 및 제2 애노드; 및 상기 제1 애노드 및 상기 제2 애노드를 각각 노출시키는 제1 오프닝 및 제2 오프닝을 포함하는 블랙 화소 정의막을 포함하며, 상기 제2 유기막 및 상기 제3 유기막은 상기 제1 애노드 및 상기 제2 애노드가 각각 상기 제1 애노드 연결 부재 및 상기 제2 애노드 연결 부재와 연결되도록 하는 제1 애노드 연결용 오프닝 및 제2 애노드 연결용 오프닝을 포함하며, 상기 제1 애노드 연결용 오프닝 또는 그 중심 및 상기 제2 애노드 연결용 오프닝 또는 그 중심을 지나는 중심선은 상기 제1 오프닝의 중심 또는 상기 제2 오프닝의 중심을 지난다. |
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