랩-어라운드 콘택들을 제조하기 위한 금속 화학 기상 증착 접근법들 및 결과 구조들

랩-어라운드 콘택들을 제조하기 위한 금속 화학 기상 증착 접근법들, 및 랩-어라운드 금속 콘택들을 갖는 반도체 구조들이 설명된다. 예에서, 집적 회로 구조가 기판 위의 반도체 피처를 포함한다. 상기 반도체 피처 위에 유전체 층이 있고, 상기 유전체 층은 상기 반도체 피처의 일부를 노출시키는 트렌치를 가지며, 그 일부는 평평하지 않은 토포그래피를 갖는다. 상기 반도체 피처의 일부 바로 위에 금속 콘택 재료가 있다. 상기 금속 콘택 재료는 상기 반도체 피처의 일부의 평평하지 않은 토포그래피와 등각이다. 상기 금속 콘택 재료는 95% 이...

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Hauptverfasser: BERGSTROM DANIEL B, LEIB JEFFREY S, WIEGAND CHRISTOPHER J
Format: Patent
Sprache:kor
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Zusammenfassung:랩-어라운드 콘택들을 제조하기 위한 금속 화학 기상 증착 접근법들, 및 랩-어라운드 금속 콘택들을 갖는 반도체 구조들이 설명된다. 예에서, 집적 회로 구조가 기판 위의 반도체 피처를 포함한다. 상기 반도체 피처 위에 유전체 층이 있고, 상기 유전체 층은 상기 반도체 피처의 일부를 노출시키는 트렌치를 가지며, 그 일부는 평평하지 않은 토포그래피를 갖는다. 상기 반도체 피처의 일부 바로 위에 금속 콘택 재료가 있다. 상기 금속 콘택 재료는 상기 반도체 피처의 일부의 평평하지 않은 토포그래피와 등각이다. 상기 금속 콘택 재료는 95% 이상의 단일 금속 종을 포함하는 총 원자 조성을 갖는다. Metal chemical vapor deposition approaches for fabricating wrap-around contacts, and semiconductor structures having wrap-around metal contacts, are described. In an example, an integrated circuit structure includes a semiconductor feature above a substrate. A dielectric layer is over the semiconductor feature, the dielectric layer having a trench exposing a portion of the semiconductor feature, the portion having a non-flat topography. A metallic contact material is directly on the portion of the semiconductor feature. The metallic contact material is conformal with the non-flat topography of the portion of the semiconductor feature. The metallic contact material has a total atomic composition including 95% or greater of a single metal species.