ELECTRONIC DEVICE AND METHOD FOR CONTROLLING CONNECTION INTERFACE
According to various embodiments, an electronic device comprises: a housing including a first surface and a second surface spaced apart from the first surface; a touch screen display exposed through a part of the first surface; at least one wireless and/or wired communication circuit located within...
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Format: | Patent |
Sprache: | eng ; kor |
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Zusammenfassung: | According to various embodiments, an electronic device comprises: a housing including a first surface and a second surface spaced apart from the first surface; a touch screen display exposed through a part of the first surface; at least one wireless and/or wired communication circuit located within the housing; at least one processor electrically connected to the communication circuit and the touch screen display and located within the housing; and a memory electrically connected to the processor and located within the housing. The communication circuit and the processor may be configured to be in one of a plurality of states for exchanging data on a bus based on a plurality of generations of a peripheral component interconnect express (PCIe) standard. The plurality states comprise: a first state using a first clock and a first data encoding rate based on a first generation of the plurality of generations; a second state using a second clock and a second data encoding rate based on a second generation of the plurality of generations; and a first recovery state defined in the first generation of the plurality of generations. In addition, various embodiments are possible. The electronic device and method is able to selectively change a connection interface module depending on a state related to a communication.
다양한 실시 예들에 따른 전자 장치(electronic device)는, 제1 표면과 상기 제1 표면과 이격된 제2 표면을 포함하는 하우징과, 상기 제1 표면의 일부를 통해 노출되는 터치스크린 디스플레이와, 상기 하우징 내에 위치되는 적어도 하나의 무선 및/또는 유선 통신 회로와, 상기 통신 회로 및 상기 터치스크린 디스플레이와 전기적으로 연결되고 상기 하우징 내에 위치되는 적어도 하나의 프로세서와, 상기 프로세서와 전기적으로 연결되고, 상기 하우징 내에 위치되는 메모리를 포함할 수 있고, 상기 통신 회로 및 상기 프로세서는 PCIe(peripheral component interconnect express) 표준(standard)의 복수의 제너레이션(generation)들에 기반하여 버스 상에서 데이터를 교환하기 위한 복수의 상태들 중 하나의 상태이도록 설정될 수 있으며, 상기 복수의 상태들은, 상기 복수의 제너레이션들 중 제1 제너레이션에 기반하여 제1 클럭 및 제1 데이터 인코딩율을 이용하는 제1 상태와, 상기 복수의 제너레이션들 중 제2 제너레이션에 기반하여 제2 클럭 및 제2 데이터 인코딩율을 이용하는 제2 상태와, 상기 복수의 제너레이션들 중 상기 제1 제너레이션에서 정의되는 제1 복원(recovery) 상태를 포함할 수 있다. 그 외에도, 다양한 실시 예들이 가능하다. |
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