METHOD, PROCESSING UNIT, AND DESIGN STRUCTURE FOR HANDLING INTERRUPTS IN PROCESSING UNIT USING VIRTUAL PROCESSOR THREAD GROUPS
PROBLEM TO BE SOLVED: To provide techniques for handling interrupts in a processing unit of a data processing system using virtual processor thread groups.SOLUTION: A technique for handling interrupts in a data processing system includes receiving, at an interrupt presentation controller (IPC), an e...
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Format: | Patent |
Sprache: | eng ; jpn |
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Zusammenfassung: | PROBLEM TO BE SOLVED: To provide techniques for handling interrupts in a processing unit of a data processing system using virtual processor thread groups.SOLUTION: A technique for handling interrupts in a data processing system includes receiving, at an interrupt presentation controller (IPC), an event notification message (ENM). The ENM specifies the event target number and the number of bits to ignore. The IPC determines a group of virtual processor threads that may be potentially interrupted on the basis of the event target number and the number of bits to ignore specified in the ENM. The event target number identifies a specific virtual processor thread and the number of bits to ignore identifies the number of lower-order bits to ignore with respect to the specific virtual processor thread when determining a group of virtual processor threads that may be potentially interrupted.SELECTED DRAWING: Figure 19
【課題】仮想プロセッサ・スレッド・グループを使用するデータ処理システムの処理ユニット内の割込みを処理するための技法を提供する。【解決手段】データ処理システム内の割込みを処理するための技法は、割込み提示コントローラ(IPC)でイベント通知メッセージ(ENM)を受信することを含む。ENMは、イベント・ターゲット番号、および無視するビット数を指定する。IPCは、ENM内で指定されるイベント・ターゲット番号および無視ビット数に基づいて、潜在的に割込みを受ける可能性がある仮想プロセッサ・スレッドのグループを決定する。潜在的に割込みを受ける可能性がある仮想プロセッサ・スレッドのグループを決定する際に、イベント・ターゲット番号は、特定の仮想プロセッサ・スレッドを特定し、無視ビット数は、特定の仮想プロセッサ・スレッドに関して下位の無視ビット数を特定する。【選択図】図19 |
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