ROUTAGE DE TRANSACTIONS SANS CONGESTION ENTRE DES EQUIPEMENTS SOURCES ET AU MOINS UN EQUIPEMENT CIBLE MULTIPORTS D'UN SYSTEME SUR PUCE
Système sur puce, comprenant un circuit d'interconnexion (ICN) comportant au moins p interfaces d'entrée (IEi) et au moins k interfaces de sortie (IS1-ISk), avec p supérieur à k, p équipements sources (ESi) respectivement couplés auxdites p interfaces d'entrée, k ports d'accès (P...
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Format: | Patent |
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Zusammenfassung: | Système sur puce, comprenant un circuit d'interconnexion (ICN) comportant au moins p interfaces d'entrée (IEi) et au moins k interfaces de sortie (IS1-ISk), avec p supérieur à k, p équipements sources (ESi) respectivement couplés auxdites p interfaces d'entrée, k ports d'accès (PA1-PAk ) respectivement couplés auxdites N interfaces de sortie et appartenant à au moins un équipement cible (EC1), chaque équipement source étant configuré pour délivrer des transactions (T1-Tp) audit au moins un équipement cible (EC1) via l'un des ports d'accès, chaque port d'accès comportant un moyen de mémoire configuré pour stocker temporairement les transactions reçues par le port d'accès et délivrer un signal de remplissage (SGr) représentatif de son taux de remplissage courant, et un module de commande (DPS) configuré pour recevoir les signaux de remplissage courants des ports d'accès et sélectionner les ports d'accès éligibles pour recevoir une transaction en fonction du taux de remplissage courant de leur moyen de mémoire associé.
A system on chip includes an interconnect circuit including at least p input interfaces and at least k output interfaces, p source devices respectively coupled to the p input interfaces and k access ports respectively coupled to the k output interfaces and belonging to a target that includes one or more target devices. Each source device is configured to deliver transactions to the target via one of the access ports. An associated memory of each access port is configured to temporarily store the transactions received by the access port. The target is configured to deliver, for each access port, a fill signal representative of a current fill level of its associated memory. A control circuit is configured to receive the fill signals from the access ports and select the access ports eligible to receive a transaction depending on the current fill levels. |
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