Memory arrangement

The read only cache memory (4) stores long duration instructions (I) or instruction blocks (B). An extraction and transmission unit (6,7,11) selectively sends, as a function of address (A) contents, the instructions of instruction blocks from the cache memory to the processor (1). Processor (1) designed to transmit program addresses (A) to a memory consisting of a principal program memory (3, in which are stored instructions (I) or instructions blocks (B) for execution by the processor (1), and a dynamic cache memory (5) in which are stored instructions or instruction blocks whose use frequency during program execution has predetermined conditions. The memory also includes means for extracting and transmitting (8,9,10,12), as a function of the address (A) contents, selective extraction and transmission, from the principal (3) or cache memory (5) instructions or instruction blocks to be executed by the processor. Each instruction or instruction block stored in the principal memory is provided with a flag. The principal program memory (3) has an output (17) at which. during extraction of an instruction or instruction block, is presented with the associated flag state. The memory includes write control logic (16) which as a function of the flag state, writes or not, into a dynamic cache RAM memory (5) the instruction or instruction block extracted from the principal memory. Ce dispositif de mémoire fonctionne avec un processeur (1) dont il contient le programme à exécuter et qui émet des adresses (A) à destination de ce dispositif de mémoire. Une mémoire de programme (3) stocke des blocs d'instructions (B) à exécuter. Une mémoire cache dynamique (5) stocke des blocs d'instructions (B) dont la fréquence d'utilisation pendant l'exécution dudit programme présente des conditions prédéterminées. Des moyens d'extraction et de transmission (8, 9, 10, 12) extraient sélectivement de la mémoire principale (3) ou de la mémoire cache dynamique (5) des blocs d'instructions (B) destinés à être exécutés par le processeur (1). Une mémoire cache morte (4) stocke des blocs d'instructions (B) utilisés le plus fréquemment par le processeur (1) au cours de l'exécution du programme. Les moyens d'extraction et de transmission (6, 7, 11) sont également agencés pour, en fonction du contenu des adresses (A), envoyer sélectivement des blocs d'instructions à partir de la mémoire cache morte (4) vers le processeur (1).