SEMI-DIFFERENTIELLE SIGNALISIERUNG ZUR VERBESSERUNG DES DSI3-BUSSES
Semi-differentielle Signalisierungstechnik sowie Busvorrichtungen und Kommunikationssysteme, die diese Technik nutzen, um die Leistungsfähigkeit des DSI3-Busses zu verbessern. In einer Ausführungsform wird eine DSI3-Master-Vorrichtung bereitgestellt, die mit einer DSI3-Slave-Vorrichtung über einen B...
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Format: | Patent |
Sprache: | ger |
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Zusammenfassung: | Semi-differentielle Signalisierungstechnik sowie Busvorrichtungen und Kommunikationssysteme, die diese Technik nutzen, um die Leistungsfähigkeit des DSI3-Busses zu verbessern. In einer Ausführungsform wird eine DSI3-Master-Vorrichtung bereitgestellt, die mit einer DSI3-Slave-Vorrichtung über einen Bus gekoppelt werden kann, der mindestens eine Stromversorgungsleitung, eine Stromrückführungsleitung und eine Signalleitung aufweist. Die Master-Vorrichtung schließt Folgendes ein: einen Stromversorgungsknoten und einen Stromrückführungsknoten, die mit der Stromversorgungsleitung bzw. der Stromrückführungsleitung verbunden sind, um die Slave-Vorrichtung mit Strom zu versorgen; einen Signalknoten, der mit der Signalleitung verbunden ist; und einen Treiber, der den Signalknoten in Bezug auf eine Referenzspannung in der Mitte zwischen den Spannungen des Stromversorgungsknotens und des Stromrückführungsknotens treibt.
A semi-differential signaling technique as well as bus devices and communication systems that exploit this technique to enhance the performance of the DSI3 bus. In one embodiment, there is provided a DSI3 master device that can be coupled to a DSI3 slave device via a bus having at least a power supply conductor, a power return conductor, and a signal conductor. The master device includes: a power supply node and a power return node that respectively connect to the power supply conductor and the power return conductor to supply power to the slave device; a signal node that connects to the signal conductor; and a driver that drives the signal node relative to a reference voltage midway between voltages of the power supply node and the power return node. |
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