VERFAHREN UND VORRICHTUNG ZUM SCHUTZ VON TRANSISTOREN

Die Erfindung betrifft ein Verfahren und eine Vorrichtung zum Schutz von in zumindest einem Pfad angeordneten Transistoren (S1, S3; S2, S4), wobei in einem Pfad (2) in Serie geschaltete Transistoren (S1, S3; S2, S4) angeordnet werden, an welchen eine Eingangsspannung (Ue) angelegt wird, und die Transistoren (S1, S3; S2, S4) eines Pfades abwechselnd zwischen einem leitenden Zustand und einem sperrenden Zustand zur Erzeugung einer Ausgangsspannung (Ua) im Mittelpunkt des Pfades umgeschaltet werden. Zur Vermeidung eines Durchschaltens beider Transistoren (S1, S3; S2, S4) eines Pfades wird vor einer Umschaltung eines Transistors (S1; S2) in den leitenden Zustand der sperrende Zustand des zweiten Transistors (S3; S4) des Pfades überprüft und die Umschaltung mit einem bei der Überprüfung generierten Signal freigegeben. The invention relates to a method and to an apparatus for protecting transistors (S1, S3; S2, S4) arranged in at least one path, wherein transistors (S1, S3; S2, S4) connected in series to which an input voltage (Ue) is applied are arranged in a path (2), and the transistors (S1, S3; S2, S4) of a path are alternately switched between a conductive state and a blocking state in order to generate an output voltage (Ua) at the center of the path. In order to prevent both transistors (S1, S3; S2, S4) of a path from triggering, the blocking state of the second transistor (S3; S4) of the path is checked before switching a transistor (S1; S2) into the conductive state, and the switching is released by way of a signal generated during the check.