High accuracy digital aging monitor based on PLL-VCO circuit
As the manufacturing process is scaled down to the nanoscale, the aging phenomenon significantly affects the reliability and lifetime of integrated circuits. Consequently, the precise measurement of digital CMOS aging is a key aspect of nanoscale aging tolerant circuit design. This paper proposes a...
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Veröffentlicht in: | Journal of semiconductors 2015, Vol.36 (1), p.158-162 |
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1. Verfasser: | |
Format: | Artikel |
Sprache: | eng |
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Online-Zugang: | Volltext |
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