METHOD, APPARATUS AND SYSTEM FOR HANDLING NON-POSTED MEMORY WRITE TRANSACTIONS IN A FABRIC

In one embodiment, a system on chip includes a first endpoint to issue a non-posted memory write transaction to a memory and a Peripheral Component Interconnect (PCI)-based fabric including control logic to direct the non-posted memory write transaction to the memory, receive a completion for the no...

Ausführliche Beschreibung

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Hauptverfasser: NAGARAJAN, Ramadass, DE GRUIJL, Robert, LAKSHMANAMURTHY, Sridhar, ADLER, Robert P, ELARDO, Peter J
Format: Patent
Sprache:eng ; fre
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creator NAGARAJAN, Ramadass
DE GRUIJL, Robert
LAKSHMANAMURTHY, Sridhar
ADLER, Robert P
ELARDO, Peter J
description In one embodiment, a system on chip includes a first endpoint to issue a non-posted memory write transaction to a memory and a Peripheral Component Interconnect (PCI)-based fabric including control logic to direct the non-posted memory write transaction to the memory, receive a completion for the non-posted memory write transaction from the memory and route the completion to the first endpoint. Other embodiments are described and claimed. Dans un mode de réalisation, un système sur puce comprend un premier point d'extrémité destiné à émettre une transaction d'écriture de mémoire non postée vers une mémoire et un tissu à base d'interconnexion de composant périphérique (PCI) comprenant une logique de commande destinée à diriger la transaction d'écriture de mémoire non postée vers la mémoire, à recevoir un achèvement pour la transaction d'écriture de mémoire non postée à partir de la mémoire et à acheminer l'achèvement vers le premier point d'extrémité. L'invention concerne également d'autres modes de réalisation.
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Other embodiments are described and claimed. Dans un mode de réalisation, un système sur puce comprend un premier point d'extrémité destiné à émettre une transaction d'écriture de mémoire non postée vers une mémoire et un tissu à base d'interconnexion de composant périphérique (PCI) comprenant une logique de commande destinée à diriger la transaction d'écriture de mémoire non postée vers la mémoire, à recevoir un achèvement pour la transaction d'écriture de mémoire non postée à partir de la mémoire et à acheminer l'achèvement vers le premier point d'extrémité. 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Other embodiments are described and claimed. Dans un mode de réalisation, un système sur puce comprend un premier point d'extrémité destiné à émettre une transaction d'écriture de mémoire non postée vers une mémoire et un tissu à base d'interconnexion de composant périphérique (PCI) comprenant une logique de commande destinée à diriger la transaction d'écriture de mémoire non postée vers la mémoire, à recevoir un achèvement pour la transaction d'écriture de mémoire non postée à partir de la mémoire et à acheminer l'achèvement vers le premier point d'extrémité. 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