SYNCHRONIZING SOURCE-SYNCHRONOUS LINKS IN A SWITCHING DEVICE

A method and apparatus for synchronizing components operating isochronously that are coupled by independent links. The apparatus includes a synchronization circuit having a first and second buffer, each including an input port coupled to an external link, an output port, a read pointer and a write p...

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1. Verfasser: LIENCRES, BJORN, O
Format: Patent
Sprache:eng ; fre
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creator LIENCRES, BJORN, O
description A method and apparatus for synchronizing components operating isochronously that are coupled by independent links. The apparatus includes a synchronization circuit having a first and second buffer, each including an input port coupled to an external link, an output port, a read pointer and a write pointer. The read pointer indicates a next location in a respective buffer to be read in transferring data out on the output port. The write pointer indicates a next location in the respective buffer to be written when receiving data on the input port and is configured to automatically increment upon receipt of a first data bit on a respective external link. A trigger circuit is coupled to each link for receiving external trigger signals. Each external trigger signal is included along with data transmitted on the link and indicates when data is present on a respective link. A counter is coupled to the trigger circuit. The counter includes a trigger input and a predefined delay period. After receipt of a first of the external trigger signals on the trigger input, the counter is operable to output a read enable signal to each of the read pointers after the delay period has expired. L'invention concerne un procédé et un appareil de synchronisation de composants qui fonctionnent de manière isochrone et qui sont connectés par des liaisons indépendantes. L'appareil comporte un circuit de synchronisation disposant d'une première et d'une seconde mémoire tampon, qui possèdent respectivement un port d'entrée relié à un liaison extérieure, un port de sortie, un pointeur de lecture et un pointeur d'écriture. Le pointeur de lecture indique un prochain emplacement, où doit se faire la lecture dans une mémoire tampon respective, en transférant des données par le port de sortie. Le pointeur d'écriture indique le prochain emplacement, où doit se faire l'écriture dans la mémoire tampon respective, lors de la réception de données par le port d'entrée. Ce pointeur est configuré pour effectuer automatiquement une incrémentation après réception d'un premier bit d'information sur une liaison extérieure respective. Un dispositif à déclenchement est relié à chaque liaison pour recevoir les signaux extérieurs de déclenchement. Chaque signal extérieur de déclenchement est inclus parmi les données transmises à la liaison et indique si des données sont présentes au niveau d'une liaison déterminée. Un compteur est couplé au circuit de déclenchement. Le compteur comporte une entrée de déclenc
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The apparatus includes a synchronization circuit having a first and second buffer, each including an input port coupled to an external link, an output port, a read pointer and a write pointer. The read pointer indicates a next location in a respective buffer to be read in transferring data out on the output port. The write pointer indicates a next location in the respective buffer to be written when receiving data on the input port and is configured to automatically increment upon receipt of a first data bit on a respective external link. A trigger circuit is coupled to each link for receiving external trigger signals. Each external trigger signal is included along with data transmitted on the link and indicates when data is present on a respective link. A counter is coupled to the trigger circuit. The counter includes a trigger input and a predefined delay period. After receipt of a first of the external trigger signals on the trigger input, the counter is operable to output a read enable signal to each of the read pointers after the delay period has expired. L'invention concerne un procédé et un appareil de synchronisation de composants qui fonctionnent de manière isochrone et qui sont connectés par des liaisons indépendantes. L'appareil comporte un circuit de synchronisation disposant d'une première et d'une seconde mémoire tampon, qui possèdent respectivement un port d'entrée relié à un liaison extérieure, un port de sortie, un pointeur de lecture et un pointeur d'écriture. Le pointeur de lecture indique un prochain emplacement, où doit se faire la lecture dans une mémoire tampon respective, en transférant des données par le port de sortie. Le pointeur d'écriture indique le prochain emplacement, où doit se faire l'écriture dans la mémoire tampon respective, lors de la réception de données par le port d'entrée. Ce pointeur est configuré pour effectuer automatiquement une incrémentation après réception d'un premier bit d'information sur une liaison extérieure respective. Un dispositif à déclenchement est relié à chaque liaison pour recevoir les signaux extérieurs de déclenchement. Chaque signal extérieur de déclenchement est inclus parmi les données transmises à la liaison et indique si des données sont présentes au niveau d'une liaison déterminée. Un compteur est couplé au circuit de déclenchement. Le compteur comporte une entrée de déclenchement et fonctionne selon une période de temporisation prédéfinie. Après réception du premier des signaux de déclenchement extérieurs au niveau de l'entrée de déclenchement, le compteur est prêt à émettre un signal de validation de lecture vers chaque pointeur de lecture après expiration de la période de temporisation.</description><edition>7</edition><language>eng ; fre</language><subject>ELECTRIC COMMUNICATION TECHNIQUE ; ELECTRICITY ; MULTIPLEX COMMUNICATION ; SELECTING ; TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHICCOMMUNICATION</subject><creationdate>2000</creationdate><oa>free_for_read</oa><woscitedreferencessubscribed>false</woscitedreferencessubscribed></display><links><openurl>$$Topenurl_article</openurl><openurlfulltext>$$Topenurlfull_article</openurlfulltext><thumbnail>$$Tsyndetics_thumb_exl</thumbnail><linktohtml>$$Uhttps://worldwide.espacenet.com/publicationDetails/biblio?FT=D&amp;date=20001116&amp;DB=EPODOC&amp;CC=WO&amp;NR=0008800A9$$EHTML$$P50$$Gepo$$Hfree_for_read</linktohtml><link.rule.ids>230,308,776,881,25542,76516</link.rule.ids><linktorsrc>$$Uhttps://worldwide.espacenet.com/publicationDetails/biblio?FT=D&amp;date=20001116&amp;DB=EPODOC&amp;CC=WO&amp;NR=0008800A9$$EView_record_in_European_Patent_Office$$FView_record_in_$$GEuropean_Patent_Office$$Hfree_for_read</linktorsrc></links><search><creatorcontrib>LIENCRES, BJORN, O</creatorcontrib><title>SYNCHRONIZING SOURCE-SYNCHRONOUS LINKS IN A SWITCHING DEVICE</title><description>A method and apparatus for synchronizing components operating isochronously that are coupled by independent links. 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