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A digital engineering curriculum with integrated, Windows-based EDA tools
von
Walczowski, L.T.
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Dimond, K.R.
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Waller, W.A.J.
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Java servlet technology for analogue module generation
von
Walczowski, L.T.
,
Waller, W.A.J.
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Training in the use of Java smart cards for embedded applications
von
Walczowski, L.T.
,
Deravi, F.
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Distributed simulation of VHDL using Jini
von
Casal-Gimenez, J.
,
Walczowski, L.T.
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Automated placement for a leaf cell generator
von
de Abreu Moreira, D.
,
Walczowski, L.T.
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6
Device sizing for silicon compilers using CSL
von
Walczowski, L.T.
,
Smith, M.H.
,
Waller, W.A.J.
,
Howard, D.
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7
Multiple server WWW-based synthesis of VLSI circuits
von
Nalbantis, D.
,
Walczowski, L.T.
,
Waller, W.A.J.
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8
O/sup 2/ADL: an object-oriented analog VLSI design language
von
Shi, K.
,
Walczowski, L.T.
,
Nalbantis, D.
,
Waller, W.A.J.
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9
Using software agents to generate VLSI layouts
von
Moreira, D.de A.
,
Walczowski, L.T.
Veröffentlicht in
IEEE expert
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10
A multi-mode simulation system for GaAs circuits
von
Shi, K.
,
Jastrzebski, A.K.
,
Walczowski, L.T.
,
Barnaby, J.
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11
Placement optimization using behavior based software agents and the genetic algorithm
von
de Abreu Moreira, D.
,
Walczowski, L.T.
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12
Analogue layout generation by World Wide Web server-based agents
von
Walczowski, L.T.
,
Nalbantis, D.
,
Waller, W.A.J.
,
Shi, K.
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13
A method for sizing transistors in CMOS op-amps
von
Smith, M.H.
,
Walczowski, L.T.
,
Waller, W.A.J.
,
Howard, D.
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14
A new bipolar op-amp IC synthesis approach
von
Shi, K.
,
Walczowski, L.T.
,
Waller, W.A.J.
,
Nalbantis, D.
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15
Rapid layout synthesis for analog VLSI
von
Walczowski, L.T.
,
Waller, W.A.J.
,
Nalbantis, D.
,
Shi, K.
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