Suchergebnisse - Sultania Anup K | OPAC THWS

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Gate oxide leakage and delay tradeoffs for dual-TOX circuits von SULTANIA, Anup K, SYLVESTER, Dennis, SAPATNEKAR, Sachin S

Veröffentlicht in IEEE transactions on very large scale integration (VLSI) systems

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Switching activity estimation for a multi-clock domain for power consumption estimation von Sultania, Anup K

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Estimation of power consumed by combinatorial circuitry von Zhang, Fan, Sultania, Anup K

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Register pull-out for sequential circuit blocks in circuit designs von Dudha, Chaithanya, Keshavdas, Govinda, Sultania, Anup K, Das, Sabyasachi

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Vectorless dynamic power estimation for sequential circuits von Zhang Fan, Sultania Anup K, Stenz Guenter

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Replicating a driver of a net in a circuit design von REDDY E. SYAMA SUNDARA, LI YAU-TSUN S, SULTANIA ANUP K

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