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    Fault Models for Logic Circuits in the Multigate Era

    Fault Models for Logic Circuits in the Multigate Era von Bhoj, A. N., Simsir, M. O., Jha, N. K.


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    A hybrid nano-CMOS architecture for defect and fault tolerance

    A hybrid nano-CMOS architecture for defect and fault tolerance von Simsir, Muzaffer O., Cadambi, Srihari, Ivančić, Franjo, Roetteler, Martin, Jha, Niraj K.


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    Fault modeling for FinFET circuits

    Fault modeling for FinFET circuits von Simsir, Muzaffer O, Bhoj, Ajay, Jha, Niraj K


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    NanoV: Nanowire-based VLSI design

    NanoV: Nanowire-based VLSI design von Simsir, Muzaffer O, Jha, Niraj K


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    Thermal characterization of BIST, scan design and sequential test methodologies

    Thermal characterization of BIST, scan design and sequential test methodologies von Simsir, M.O., Jha, N.K.


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    Fault-Tolerant Computing Using a Hybrid Nano-CMOS Architecture

    Fault-Tolerant Computing Using a Hybrid Nano-CMOS Architecture von Simsir, Muzaffer O., Cadambi, Srihari, Ivancic, Franjo, Roetteler, Martin, Jha, Niraj K.


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