Suchergebnisse - Schelm Kerstin C

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Rapid substring detection within a data element string von Figuli, Razvan Peter, Schelm, Kerstin C, Payer, Stefan, Lichtenau, Cedric

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RAPID SUBSTRING DETECTION WITHIN A DATA ELEMENT STRING von Figuli, Razvan Peter, Schelm, Kerstin C, Payer, Stefan, Lichtenau, Cedric

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Clock-gating for multicycle instructions von Haess, Juergen, Lichtenau, Cédric, Schelm, Kerstin C, Payer, Stefan

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COGNITIVE BINARY CODED DECIMAL TO BINARY NUMBER CONVERSION HARDWARE von Haess, Juergen, Schelm, Kerstin C, Payer, Stefan, Lichtenau, Cedric

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Clock-gating for multicycle instructions von Haess, Juergen, Lichtenau, Cédric, Schelm, Kerstin C, Payer, Stefan

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CLOCK-GATING FOR MULTICYCLE INSTRUCTIONS von Payer Stefan, Schelm Kerstin C, Haess Juergen, Lichtenau Cédric

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CLOCK-GATING FOR MULTICYCLE INSTRUCTIONS von Payer Stefan, Schelm Kerstin C, Haess Juergen, Lichtenau Cédric

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Zero detection of a sum of inputs without performing an addition von Niekisch, Manuela, Schelm, Kerstin C, Kroener, Michael K, Mueller, Silvia M

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ZERO DETECTION OF A SUM OF INPUTS WITHOUT PERFORMING AN ADDITION von Niekisch, Manuela, Schelm, Kerstin C, Kroener, Michael K, Mueller, Silvia M

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ZERO DETECTION OF A SUM OF INPUTS WITHOUT PERFORMING AN ADDITION von Niekisch, Manuela, Schelm, Kerstin C, Kroener, Michael K, Mueller, Silvia M

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Method,system and computer program product for clock-gating for multicycle instructions von LICHTENAU, CEDRIC, SCHELM, KERSTIN C, PAYER, STEFAN, HAESS, JUERGEN

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Clock-gating for multicycle instructions von LICHTENAU, CEDRIC, SCHELM, KERSTIN C, PAYER, STEFAN, HAESS, JUERGEN

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The POWER7 Binary Floating-Point Unit von Boersma, M., Kroner, M., Layer, C., Leber, P., Muller, S. M., Schelm, K.

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Rapid substring detection within a data element string von Figuli, Razvan Peter, Schelm, Kerstin C, Payer, Stefan, Lichtenau, Cedric

RAPID SUBSTRING DETECTION WITHIN A DATA ELEMENT STRING von Figuli, Razvan Peter, Schelm, Kerstin C, Payer, Stefan, Lichtenau, Cedric

Clock-gating for multicycle instructions von Haess, Juergen, Lichtenau, Cédric, Schelm, Kerstin C, Payer, Stefan

COGNITIVE BINARY CODED DECIMAL TO BINARY NUMBER CONVERSION HARDWARE von Haess, Juergen, Schelm, Kerstin C, Payer, Stefan, Lichtenau, Cedric

Clock-gating for multicycle instructions von Haess, Juergen, Lichtenau, Cédric, Schelm, Kerstin C, Payer, Stefan

CLOCK-GATING FOR MULTICYCLE INSTRUCTIONS von Payer Stefan, Schelm Kerstin C, Haess Juergen, Lichtenau Cédric

CLOCK-GATING FOR MULTICYCLE INSTRUCTIONS von Payer Stefan, Schelm Kerstin C, Haess Juergen, Lichtenau Cédric

Zero detection of a sum of inputs without performing an addition von Niekisch, Manuela, Schelm, Kerstin C, Kroener, Michael K, Mueller, Silvia M

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Method,system and computer program product for clock-gating for multicycle instructions von LICHTENAU, CEDRIC, SCHELM, KERSTIN C, PAYER, STEFAN, HAESS, JUERGEN

Clock-gating for multicycle instructions von LICHTENAU, CEDRIC, SCHELM, KERSTIN C, PAYER, STEFAN, HAESS, JUERGEN

The POWER7 Binary Floating-Point Unit von Boersma, M., Kroner, M., Layer, C., Leber, P., Muller, S. M., Schelm, K.

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