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Raghunathan, SheshaShayee K
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Suchergebnisse - Raghunathan, SheshaShayee K
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ARCHITECTURE FOR ORDERED WRITE OF DATA COLLECTED IN PARALLEL
von
Kumar, Maurya Prabhat
,
Raghunathan, SheshaShayee K
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2
RECOMMENDING CHANGES IN THE DESIGN OF AN INTEGRATED CIRCUIT USING A RULES-BASED ANALYSIS OF FAILURES
von
BHAT, Chaitra M
,
DAVIS, Morgan D
,
GATES, Charles
,
KURTZ, Steven Joseph
,
CAVITT, Chris
,
KALAFALA, Kerim
,
RAGHUNATHAN, SheshaShayee K
,
DEAN, Debra
,
TAGGART, Richard William
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3
RECOMMENDING CHANGES IN THE DESIGN OF AN INTEGRATED CIRCUIT USING A RULES-BASED ANALYSIS OF FAILURES
von
Davis, Morgan D
,
Raghunathan, SheshaShayee K
,
Bhat, Chaitra M
,
Cavitt, Chris
,
Dean, Debra
,
Taggart, Richard William
,
Kurtz, Steven Joseph
,
Kalafala, Kerim
,
Gates, Charles
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4
Statistical timing using macro-model considering statistical timing value entry
von
Sinha Debjit
,
Hu Jin
,
Zolotov Vladimir P
,
Raghunathan SheshaShayee K
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5
STATISTICAL TIMING USING MACRO-MODEL CONSIDERING STATISTICAL TIMING VALUE ENTRY
von
Sinha Debjit
,
Hu Jin
,
Zolotov Vladimir P
,
Raghunathan SheshaShayee K
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6
Variation-aware timing analysis using waveform construction
von
Wood Michael H
,
Sinha Debjit
,
Zolotov Vladimir
,
Kalafala Kerim
,
Raghunathan SheshaShayee K
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7
VARIATION-AWARE TIMING ANALYSIS USING WAVEFORM CONSTRUCTION
von
Wood Michael H
,
Sinha Debjit
,
Zolotov Vladimir
,
Kalafala Kerim
,
Raghunathan SheshaShayee K
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Patent
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Esp@Cenet
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