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A 14-nm Ultra-Low Jitter Fractional-N PLL Using a DTC Range Reduction Technique and a Reconfigurable Dual-Core VCO
von
Wu, Wanghua
,
Yao, Chih-Wei
,
Guo, Chengkai
,
Chiang, Pei-Yuan
,
Chen, Lei
,
Lau, Pak-Kim
,
Bai, Zhanjun
,
Son, Sang Won
,
Cho, Thomas Byunghak
Veröffentlicht in
IEEE journal of solid-state circuits
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A 200 MS/s passive switched-capacitor FIR equalizer using a time-interleaved topology
von
Guilar, N.J.
,
Pak-Kim Lau
,
Hurst, P.J.
,
Lewis, S.H.
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On-die verification of resistor fabricated in CMOS process
von
Lau, Pak-Kim
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ON-DIE VERIFICATION OF RESISTOR FABRICATED IN CMOS PROCESS
von
Lau Pak-Kim
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High-speed programmable frequency divider with 50% output duty cycle
von
Chu Min
,
Lau Pak-Kim
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Patent
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A Passive Switched-Capacitor Finite-Impulse-Response Equalizer
von
Guilar, N.J.
,
Lau, F.
,
Hurst, P.J.
,
Lewis, S.H.
Veröffentlicht in
IEEE journal of solid-state circuits
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