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Increasing Interconnection Network Throughput with Virtual Channels
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Research Challenges for On-Chip Interconnection Networks
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Designing Efficient Heterogeneous Memory Architectures
Veröffentlicht in IEEE MICRO
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Scaling to the end of silicon with EDGE architectures
Veröffentlicht in Computer (Long Beach, Calif.)
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Scaling Power and Performance viaProcessor Composability
Veröffentlicht in IEEE transactions on computers
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