Suchergebnisse - Karandikar, Shrirang K. | OPAC THWS

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Fast comparisons of circuit implementations von Karandikar, S.K., Sapatnekar, S.S.

Veröffentlicht in IEEE transactions on very large scale integration (VLSI) systems

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2

Technology mapping for SOI domino logic incorporating solutions for the parasitic bipolar effect von Karandikar, S.K., Sapatnekar, S.S.

Veröffentlicht in IEEE transactions on very large scale integration (VLSI) systems

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3

Techniques for Fast Physical Synthesis von Alpert, Charles J., Karandikar, Shrirang K., Li, Zhuo, Nam, Gi-Joon, Quay, Stephen T., Ren, Haoxing, Sze, C. N., Villarrubia, Paul G., Yildiz, Mehmet C.

Veröffentlicht in Proceedings of the IEEE

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4

Fast Algorithms for Slew-Constrained Minimum Cost Buffering von Shiyan Hu, Alpert, C.J., Jiang Hu, Karandikar, S.K., Zhuo Li, Weiping Shi, Sze, C.N.

Veröffentlicht in IEEE transactions on computer-aided design of integrated circuits and systems

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5

Technology Mapping Using Logical Effort for Solving the Load-Distribution Problem von Karandikar, S.K., Sapatnekar, S.S.

Veröffentlicht in IEEE transactions on computer-aided design of integrated circuits and systems

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6

Techniques for fast physical synthesis: Leading-edge computer aided design solutions for advanced digital and mixed-signal systems-on-chips von ALPERT, Charles J, KARANDIKAR, Shrirang K, ZHUO LI, NAM, Gi-Joon, QUAY, Stephen T, HAOXING REN, SZE, C. N, VILLARRUBIA, Paul G, YILDIZ, Mehmet C

Veröffentlicht in Proceedings of the IEEE

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7

Logical effort based technology mapping von Karandikar, S. K., Sapatnekar, S. S.

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8

Fast estimation of area-delay trade-offs in circuit sizing von Karandikar, S.K., Sapatnekar, S.S.

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Fast comparisons of circuit implementations von Karandikar, S.K., Sapatnekar, S.S.

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10

Fast Comparisons of Circuit Implementations von Karandikar, Shrirang K., Sapatnekar, Sachin S.

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11

Fast Electrical Correction Using Resizing and Buffering von Karandikar, S.K., Alpert, C.J., Yildiz, M.C., Villarrubia, P., Quay, S., Mahmud, T.

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