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LOGIC SIMULATOR
von
MIZOGAMI YOSHITO
,
YAMADA YASUNORI
,
KOSHISHITA JUNJI
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2
Incremental Logic Synthesis through Gate Logic Structure Identification
von
Shinsha, T.
,
Kubo, T.
,
Sakataya, Y.
,
Koshishita, J.
,
Ishihara, K.
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Tagungsbericht
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3
LOGICAL DESIGN SUPPORT METHOD
von
MIZOGAMI YOSHITO
,
YAMADA YASUNORI
,
MOTOMURA TETSURO
,
NIIYA TAKAO
,
KOSHISHITA JIYUNJI
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4
Incremental logic synthesis through gate logic structure identification
von
Shinsha, T.
,
Kubo, T.
,
Sakataya, Y.
,
Koshishita, J.
,
Ishihara, K.
Volltext
Tagungsbericht
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5
Logic synthesis method and system with intermediate circuit files
von
SAKAKI
,
HIROMOTO
,
NAKATA
,
TAKAHIRO
,
KOSHISHITA
,
JUNJI
,
HAYASHI
,
NOBUYUKI
,
TANDAI
,
MIYAKO
,
MATSUMOTO
,
KAZUHIKO
,
SHINSHA
,
TAKAO
,
YAMADA
,
YASUNORI
,
MORIWAKI
,
KAORU
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6
LOGIC GENERATION METHOD
von
MATSUMOTO KAZUHIKO
,
MORIWAKI IKU
,
TANDAI MIYAKO
,
NAKADA TAKAHIRO
,
YAMADA YASUNORI
,
SAKAKI HIROMOTO
,
NIIYA TAKAO
,
HAYASHI NOBUYUKI
,
KOSHISHITA JIYUNJI
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7
Incremental logic synthesis method
von
HIKOSAKA
,
MITSUHIRO
,
AKIYAMA
,
KEIHO
,
KOSHISHITA
,
JUNJI
,
KUBO
,
TAKASHIGE
,
SHINSHA
,
TAKAO
,
SAKATAYA
,
YOSHINORI
,
MORITA
,
MASATO
,
TSUCHIYA
,
YOJI
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8
REUSE SYSTEM FOR LOGIC CIRCUIT
von
IKARIYA YUKIO
,
UEMATSU SEIYA
,
NIIYA TAKAO
,
KUBO TAKASHIGE
,
OZAWA YASUSHI
,
OIDA ATSUSHI
,
TSUCHIYA HIROTSUGU
,
KOSHISHITA JIYUNJI
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9
GATE LOGIC AUTOMATIC RENEWING METHOD
von
HIKOSAKA MICHIHIRO
,
AKIYAMA SHIGEO
,
MORITA MASATO
,
NIIYA TAKAO
,
KUBO TAKASHIGE
,
SAKATAYA YOSHINORI
,
TSUCHIYA HIROTSUGU
,
KOSHISHITA JIYUNJI
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10
LOGIC VERIFICATION SUFFICIENCY EVALUATING METHOD
von
AMANO NOBUTAKA
,
IKARIYA YUKIO
,
MATSUMOTO KAZUHIKO
,
MIYOSHI MASAYUKI
,
NIIYA TAKAO
,
KUBO TAKASHIGE
,
OZAWA YASUSHI
,
TSUCHIYA HIROTSUGU
,
KOSHISHITA JIYUNJI
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Ieee Electronic Library (Iel) Conference Proceedings
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Acm Digital Library Complete
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Ieee Power & Energy Library
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Ieee Electronic Library (Iel)
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Ingenta Connect
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