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A 3 GHz Dual Core Processor ARM Cortex TM -A9 in 28 nm UTBB FD-SOI CMOS With Ultra-Wide Voltage Range and Energy Efficiency Optimization
von
Jacquet, David
,
Hasbani, Frederic
,
Flatresse, Philippe
,
Wilson, Robin
,
Arnaud, Franck
,
Cesana, Giorgio
,
Di Gilio, Thierry
,
Lecocq, Christophe
,
Roy, Tanmoy
,
Chhabra, Amit
,
Grover, Chiranjeev
,
Minez, Olivier
,
Uginet, Jacky
,
Durieu, Guy
,
Adobati, Cyril
,
Casalotto, Davide
,
Nyer, Frederic
,
Menut, Patrick
,
Cathelin, Andreia
,
Vongsavady, Indavong
,
Magarshack, Philippe
Veröffentlicht in
IEEE journal of solid-state circuits
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Content addressable memory architecture providing improved speed
von
Srivastavaan, Rajeev
,
Grover, Chiranjeev
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Content addressable memory architecture providing improved speed
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GROVER CHIRANJEEV
,
SRIVASTAVAAN RAJEEV
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A content addressable memory (CAM) architecture providing improved speed
von
SRIVASTAVAAN, RAJEEV
,
GROVER, CHIRANJEEV
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GROVER CHIRANJEEV
,
SRIVASTAVAAN RAJEEV
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Grover, Chiranjeev
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Von:
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1400 : 2025
1400
2025
Quelle
Esp@Cenet
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Ieee Power & Energy Library
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Uspto Issued Patents
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Uspto Published Applications
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Ieee Electronic Library (Iel)
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Ingentaconnect
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