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    Improved implementation of a modified Discrete Cosine Transform on low-cost FPGA

    Improved implementation of a modified Discrete Cosine Transform on low-cost FPGA von Belkouch, S, El Aakif, M, Ouahman, A A, Hassani, M M

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    Low power and fast DCT architecture using multiplier-less method

    Low power and fast DCT architecture using multiplier-less method von El Aakif, M., Belkouch, S., Chabini, N., Hassani, M. M.

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    An efficient pipelined fast and multiplier-less 2-D IDCT for image/video decoding

    An efficient pipelined fast and multiplier-less 2-D IDCT for image/video decoding von El Aakif, M., Belkouch, S., Hassani, M. M.

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    FPGA implementation of a pipelined 2D-DCT and simplified quantization for real-time applications

    FPGA implementation of a pipelined 2D-DCT and simplified quantization for real-time applications von Anas, H., Belkouch, S., El Aakif, M., Chabini, N.

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