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GENERATING A LAYOUT FOR AN INTEGRATED CIRCUIT
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Koch, Michael
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YIELD IMPROVING LEAF CELLS OPTIMIZATION FOR SEMICONDUCTOR NETLISTS
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Ringe, Matthias
,
Koch, Michael V
,
Arp, Andreas H.A
,
Makowski, Thomas
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ADAPTIVE CLOCK MESH WIRING
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,
Ringe, Matthias
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STATIC COMPENSATION OF AN ACTIVE CLOCK EDGE SHIFT FOR A DUTY CYCLE CORRECTION CIRCUIT
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Ringe, Matthias
,
Koch, Michael V
,
Arp, Andreas H.A
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ROUTING A CELL OF A SEMICONDUCTOR CHIP
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,
Ringe, Matthias
,
Koch, Michael V
,
Arp, Andreas H.A
,
Makowski, Thomas
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GENERATING A LAYOUT FOR AN INTEGRATED CIRCUIT
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Ringe Matthias
,
Koch Michael
,
Arp Andreas H.A
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GENERATING A LAYOUT FOR AN INTEGRATED CIRCUIT
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,
Koch Michael
,
Arp Andreas H.A
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STATIC COMPENSATION OF AN ACTIVE CLOCK EDGE SHIFT FOR A DUTY CYCLE CORRECTION CIRCUIT
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Ringe, Matthias
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Koch, Michael V
,
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DOUBLE COMPRESSION AVOIDANCE
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Cilek, Fatih
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Ringe, Matthias
,
Koch, Michael V
,
Arp, Andreas H.A
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DOUBLE COMPRESSION AVOIDANCE
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Ringe, Matthias
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Koch, Michael V
,
Arp, Andreas H.A
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CALIBRATING INTERNAL PULSES IN AN INTEGRATED CIRCUIT
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,
Ringe, Matthias
,
Koch, Michael V
,
Arp, Andreas H.A
,
Makowski, Thomas
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BURN-IN RESILIENT INTEGRATED CIRCUIT FOR PROCESSORS
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Ringe, Matthias
,
Koch, Michael V
,
Arp, Andreas H.A
,
Makowski, Thomas
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OPTIMALLY DRIVING NON-UNIFORM CLOCK MESH LOADS
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Makowski, Thomas
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